lunaix-os/arch/i386/includes/sys/apic.h

   1 #ifndef __LUNAIX_APIC_H
   2 #define __LUNAIX_APIC_H
   3
   4 #include <hal/intc.h>
   5 #include <lunaix/common.h>
   6 #include <lunaix/types.h>
   7
   8 #define __APIC_BASE_PADDR 0xFEE00000
   9
  10 #define IA32_MSR_APIC_BASE 0x1B
  11 #define IA32_APIC_ENABLE 0x800
  12
  13 /*
  14  *  Common APIC memory-mapped registers
  15  *              Ref: Intel Manual, Vol. 3A, Table 10-1
  16  */
  17
  18 #define APIC_IDR 0x20   // ID Reg
  19 #define APIC_VER 0x30   // Version Reg
  20 #define APIC_TPR 0x80   // Task Priority
  21 #define APIC_APR 0x90   // Arbitration Priority
  22 #define APIC_PPR 0xA0   // Processor Priority
  23 #define APIC_EOI 0xB0   // End-Of-Interrupt
  24 #define APIC_RRD 0xC0   // Remote Read
  25 #define APIC_LDR 0xD0   // Local Destination Reg
  26 #define APIC_DFR 0xE0   // Destination Format Reg
  27 #define APIC_SPIVR 0xF0 // Spurious Interrupt Vector Reg
  28 #define APIC_ISR_BASE                                                          \
  29     0x100 // Base address for In-Service-Interrupt bitmap register (256bits)
  30 #define APIC_TMR_BASE                                                          \
  31     0x180 // Base address for Trigger-Mode bitmap register (256bits)
  32 #define APIC_IRR_BASE                                                          \
  33     0x200 // Base address for Interrupt-Request bitmap register (256bits)
  34 #define APIC_ESR 0x280      // Error Status Reg
  35 #define APIC_ICR_BASE 0x300 // Interrupt Command
  36 #define APIC_LVT_LINT0 0x350
  37 #define APIC_LVT_LINT1 0x360
  38 #define APIC_LVT_ERROR 0x370
  39
  40 // APIC Timer specific
  41 #define APIC_TIMER_LVT 0x320
  42 #define APIC_TIMER_ICR 0x380 // Initial Count
  43 #define APIC_TIMER_CCR 0x390 // Current Count
  44 #define APIC_TIMER_DCR 0x3E0 // Divide Configuration
  45
  46 #define APIC_SPIV_FOCUS_DISABLE 0x200
  47 #define APIC_SPIV_APIC_ENABLE 0x100
  48 #define APIC_SPIV_EOI_BROADCAST 0x1000
  49
  50 #define LVT_DELIVERY_FIXED 0
  51 #define LVT_DELIVERY_NMI (0x4 << 8)
  52 #define LVT_TRIGGER_EDGE (0 << 15)
  53 #define LVT_TRIGGER_LEVEL (1 << 15)
  54 #define LVT_MASKED (1 << 16)
  55 #define LVT_TIMER_ONESHOT (0 << 17)
  56 #define LVT_TIMER_PERIODIC (1 << 17)
  57
  58 // Dividers for timer. See Intel Manual Vol3A. 10-17 (pp. 3207), Figure 10-10
  59 #define APIC_TIMER_DIV1 0b1011
  60 #define APIC_TIMER_DIV2 0b0000
  61 #define APIC_TIMER_DIV4 0b0001
  62 #define APIC_TIMER_DIV8 0b0010
  63 #define APIC_TIMER_DIV16 0b0011
  64 #define APIC_TIMER_DIV32 0b1000
  65 #define APIC_TIMER_DIV64 0b1001
  66 #define APIC_TIMER_DIV128 0b1010
  67
  68 #define APIC_PRIORITY(cls, subcls) (((cls) << 4) | (subcls))
  69
  70 unsigned int
  71 apic_read_reg(unsigned int reg);
  72
  73 void
  74 apic_write_reg(unsigned int reg, unsigned int val);
  75
  76 void
  77 apic_init();
  78
  79 void
  80 apic_on_eoi(struct intc_context* intc_ctx, cpu_t cpu, int iv);
  81
  82 #endif /* __LUNAIX_APIC_H */